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使用RISC-V縮小SoC開(kāi)放標(biāo)準(zhǔn)中的差距

eeDesigner ? 來(lái)源:物聯(lián)網(wǎng)評(píng)論 ? 作者:物聯(lián)網(wǎng)評(píng)論 ? 2022-04-29 15:18 ? 次閱讀

在過(guò)去的 3 或 4 年中,半導(dǎo)體行業(yè)發(fā)生了巨大變化。大約在 1980 年左右,一些較大的半導(dǎo)體公司進(jìn)行了強(qiáng)烈的垂直整合,不僅設(shè)計(jì)和制造了他們的產(chǎn)品,甚至還制造了自己的加工設(shè)備和內(nèi)部 EDA 工具。如今,幾乎每家半導(dǎo)體公司都使用第 3方設(shè)備進(jìn)行 IC 制造和設(shè)計(jì),使用第 3方EDA 工具和第 3 方 IP。半導(dǎo)體行業(yè)發(fā)生解體的一個(gè)關(guān)鍵原因是使用開(kāi)放標(biāo)準(zhǔn)

開(kāi)放標(biāo)準(zhǔn)沒(méi)有普遍認(rèn)可的定義,但普遍認(rèn)為它們是在合理和非歧視性的基礎(chǔ)上可用的。在許多情況下,尤其是在SoC 設(shè)計(jì)中,此類(lèi)標(biāo)準(zhǔn)可免版稅使用。許多開(kāi)放標(biāo)準(zhǔn)由獨(dú)立機(jī)構(gòu)擁有,例如 IEEE、OSI 和 IETF(互聯(lián)網(wǎng)工程任務(wù)組),而不是公司。在這種情況下,標(biāo)準(zhǔn)的進(jìn)一步發(fā)展是通過(guò)一個(gè)廣泛參與的開(kāi)放過(guò)程。

開(kāi)放標(biāo)準(zhǔn)和 SOC 設(shè)計(jì)

值得從硬件和軟件角度研究 SoC 的開(kāi)放標(biāo)準(zhǔn)。對(duì)于嵌入式軟件,C 和 C++ 已成為公認(rèn)的開(kāi)放標(biāo)準(zhǔn)。因此,中間件和實(shí)時(shí)操作系統(tǒng) ( RTOS ) 經(jīng)常使用其中一種語(yǔ)言作為源代碼提供。在存在處理器或外圍設(shè)備依賴(lài)關(guān)系的情況下,可能需要進(jìn)行一些移植,但通常設(shè)計(jì)團(tuán)隊(duì)可以解決這個(gè)問(wèn)題。

在許多當(dāng)前的設(shè)備中,尤其是在物聯(lián)網(wǎng)中,SoC 具有有線(xiàn)或無(wú)線(xiàn)通信。此類(lèi)鏈接需要基于開(kāi)放標(biāo)準(zhǔn)的通信協(xié)議,例如以太網(wǎng)藍(lán)牙 LE。這種聯(lián)網(wǎng)設(shè)備也可能需要某種安全性,并且開(kāi)放標(biāo)準(zhǔn)再次支持安全通信。

在數(shù)字硬件設(shè)計(jì)中,微架構(gòu)是用硬件描述語(yǔ)言來(lái)描述的。Verilog和 VHDL都是IEEE 開(kāi)放標(biāo)準(zhǔn),RTL描述將綜合到門(mén)級(jí)。處理器和外圍設(shè)備經(jīng)常通過(guò)AMBA總線(xiàn)連接,這些總線(xiàn)是 Arm 擁有的一組標(biāo)準(zhǔn),但可免版稅使用。

驗(yàn)證將經(jīng)常使用UVM (通用驗(yàn)證方法)完成,它也是由 Accellera 行業(yè)組織管理的開(kāi)放標(biāo)準(zhǔn)。功率意圖可以用UPF (統(tǒng)一功率格式)表示 - 另一個(gè) Accellera 標(biāo)準(zhǔn)。

最后,在物理設(shè)計(jì)層面,硅制造需要布局。幾十年來(lái),最初在 Calma 開(kāi)發(fā)的 GDSII 一直被用作主要的交換格式。最近,OASIS(開(kāi)放藝術(shù)品系統(tǒng)交換標(biāo)準(zhǔn))已被用作布局的開(kāi)放標(biāo)準(zhǔn)。

開(kāi)放標(biāo)準(zhǔn)的好處

開(kāi)放標(biāo)準(zhǔn)為工業(yè)提供了許多好處。首先,它們提供了芯片之間、軟件包之間以及設(shè)計(jì)工具之間的互操作性。這使得分解成為可能。

其次,如果有開(kāi)放標(biāo)準(zhǔn),就有機(jī)會(huì)發(fā)展產(chǎn)品和供應(yīng)商的生態(tài)系統(tǒng)。例如,對(duì)于 C 語(yǔ)言,有大量可用的軟件開(kāi)發(fā)工具以及用于嵌入式軟件重用的中間件和 RTOS 產(chǎn)品。在硬件層面,有大量使用開(kāi)放標(biāo)準(zhǔn)的EDA 工具,例如 Verilog、UVM 和 OASIS。這意味著開(kāi)發(fā)團(tuán)隊(duì)可以選擇多種供應(yīng)商,而無(wú)需依賴(lài)單一供應(yīng)商。

第三,開(kāi)放標(biāo)準(zhǔn)意味著已經(jīng)完成了一個(gè)級(jí)別的規(guī)范,允許產(chǎn)品公司通過(guò)實(shí)施來(lái)專(zhuān)注于差異化。

然而,“房間里的大象”是開(kāi)放標(biāo)準(zhǔn)存在明顯差距。ISA 代表了硬件和軟件之間最重要的接口,但這在歷史上幾乎完全由專(zhuān)有 ISA保留。

使用 RISC-V 縮小開(kāi)放標(biāo)準(zhǔn)的差距

RISC-V首次為具有真正行業(yè)支持的 ISA 提供了真正開(kāi)放的標(biāo)準(zhǔn)。ISA 將非常輕量級(jí)的基本整數(shù)指令集與標(biāo)準(zhǔn)和自定義擴(kuò)展的靈活性相結(jié)合。RISC-V ISA 沒(méi)有指定微架構(gòu),例如,Codasip 開(kāi)發(fā)了具有三級(jí)、五級(jí)和七級(jí)流水線(xiàn)的 RISC-V 處理器內(nèi)核,從而允許設(shè)計(jì)人員根據(jù)他們的需求匹配內(nèi)核。IP 供應(yīng)商通過(guò)微架構(gòu)來(lái)區(qū)分。

嵌入式軟件供應(yīng)商和 SoC 開(kāi)發(fā)人員的一個(gè)直接好處是,將中間件作為二進(jìn)制文件(以及源代碼)提供是很有吸引力的。僅此一項(xiàng)就可以通過(guò)簡(jiǎn)化嵌入式軟件開(kāi)發(fā)人員的工作來(lái)幫助加速 RISC-V 的采用。

使用開(kāi)放式 ISA 是快速擴(kuò)展生態(tài)系統(tǒng)的催化劑,該生態(tài)系統(tǒng)包括處理器 IP 供應(yīng)商、軟件開(kāi)發(fā)工具供應(yīng)商、軟件公司和半導(dǎo)體公司。就像在網(wǎng)絡(luò)領(lǐng)域一樣,令牌環(huán)專(zhuān)有產(chǎn)品在 1990 年左右被不斷增長(zhǎng)的以太網(wǎng)生態(tài)系統(tǒng)擠出,我們可以預(yù)期專(zhuān)有 ISA 將在未來(lái)十年被 RISC-V 擠出。

最后,對(duì)于開(kāi)發(fā)自己的處理器內(nèi)核的公司,基本指令集可免版稅使用。RISC-V ISA 的模塊化和可擴(kuò)展性意味著已經(jīng)定義了基本指令,開(kāi)發(fā)人員可以專(zhuān)注于其內(nèi)核或加速器的特定增值。

采用 RISC-V 現(xiàn)在是嵌入式 SoC 開(kāi)發(fā)人員的低風(fēng)險(xiǎn)選擇。SoC 開(kāi)放標(biāo)準(zhǔn)中的關(guān)鍵差距已經(jīng)縮小,對(duì)硬件和軟件開(kāi)發(fā)人員都有好處。

審核編輯:符乾江

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