楷登電子（美國 Cadence 公司，NASDAQ：CDNS）今日宣布，Cadence GDDR6 IP 在 TSMC N5 工藝節(jié)點上順利通過硅驗證，性能超越 Cadence 上一代 16Gbps 設計。GDDR6 IP 包括 Cadence PHY 和控制器 Design IP 以及驗證 IP（VIP），專門針對超高帶寬的存儲器應用，如超大規(guī)模計算、5G 通信、汽車和消費電子。GDDR6 特別適用于人工智能/機器學習（AI/ML）芯片中的內存接口，隨著人工智能推理應用不斷增加，這些芯片的數(shù)量也在激增。客戶在使用 Cadence 和 TSMC 技術設計這些連接到 GDDR6 存儲器的芯片時，可以加快開發(fā)速度并降低風險。

Cadence GDDR6 IP 在 TSMC N5 節(jié)點上以 22 Gbps 的速度運行，數(shù)據(jù)速率是 DDR5 和 LPDDR5 等其他最新一代標準的 2 倍以上，比 Cadence 上一代的 16 Gbps 設計要快 37%。在全工作條件范圍內，改進后的架構允許每個 pin 有高達 22 Gb/s 的帶寬（每個芯片達 704Gb/s），運行功耗和空閑功耗小，比特誤碼率（BER）低，以實現(xiàn)更高的可靠性和更大的帶寬。相應的 GDDR6 控制器 IP 延續(xù)了 Cadence DDR 控制器設計的各種性能和可靠性優(yōu)勢。

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“與 Cadence 上一代面向 TSMC N7、N6 和 12nm FinFET Compact（12FFC）工藝的解決方案相比，Cadence 針對 TSMC N5 制程的最新 GDDR6 IP 實現(xiàn)了硅片性能的大幅提升。這是我們最新的合作成果，它將 Cadence 領先的 IP 解決方案與 TSMC 先進的制程技術相結合，為 AI/ML、超大規(guī)模應用和其他計算密集型應用中的新芯片提供支持。”

——Dan Kochpatcharin

TSMC 設計基礎設施管理部主管

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“Cadence 致力于擴大我們的 IP 產品組合，以滿足客戶不斷變化的設計要求?？蛻衄F(xiàn)在可以信心滿滿地在 TSMC N5 工藝節(jié)點上利用 Cadence GDDR6 設計 IP 實現(xiàn)更高的帶寬?；?GDDR6 的 PHY 和控制器設計 IP 經(jīng)過改進，在 TSMC N5 工藝中的 DRAM 數(shù)據(jù)速率為 22Gbps，是 TSMC 先進節(jié)點 GDDR6 系列 IP 中速率最快的?！?/p>

——Sanjive Agarwala

Cadence 公司副總裁兼 IP 事業(yè)部總經(jīng)理

GDDR6 IP 支持 Cadence 智能系統(tǒng)設計（Intelligent System Design）戰(zhàn)略，旨在實現(xiàn)先進節(jié)點系統(tǒng)級芯片（SoC）卓越設計。

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審核編輯 ：李倩