Nios系統(tǒng)的所有外設(shè)都是通過Avalon總線與Nios CPU相接的,Avalon總線是一種協(xié)議較為簡單的片內(nèi)總線,Nios通過Avalon總線與外界進行數(shù)據(jù)交換。
Avalon總線接口分類
可分為兩類:Slave和Master。slave是一個從控接口,而master是一個主控接口。slave和master主要的區(qū)別是對于Avalon總線控制權(quán)的把握。master接口具有相接的Avalon總線控制權(quán),而slave接口是被動的。常見的Avalon的傳輸結(jié)構(gòu)有:Avalon總線從讀(slave read),Avalon總線帶一個延遲狀態(tài)從讀,Avalon總線從寫(slave write),Avalon總線帶一個延遲狀態(tài)從寫。
Avalon總線的特點有
所有外設(shè)的接口與Avalon總線時鐘同步,不需要復(fù)雜的握手/應(yīng)答機制。這樣就簡化了Avalon總 線的時序行為,而且便于集成高速外設(shè)。Avalon總線以及整個系統(tǒng)的性能可以采用標準的同步時序分析技術(shù)來評估。
所有的信號都是高電平或低電平有效,便于信號在總線中高速傳輸。在Avalon總線中,由數(shù)據(jù)選擇器(而不是三態(tài)緩沖器)決定哪個信號驅(qū)動哪個外設(shè)。因此外設(shè)即使在未被選中時也不需要將輸出置為高阻態(tài)。
為了方便外設(shè)的設(shè)計,地址、數(shù)據(jù)和控制信號使用分離的、專用的端口。外設(shè)不需要識別地址總線周期和數(shù)據(jù)總線周期,也不需要在未被選中時使輸出無效。分離的地址、數(shù)據(jù)和控制通道還簡化了與片上用戶自定義邏輯的連接 。
其他特性和約定
Avalon總線還包括許多其他特性和約定,用以支持SOPC Builder軟件自動生成系統(tǒng)、總線和外設(shè),包括:
最大4GB的地址空間——存儲器和外設(shè)可以映像到32位地址空間中的任意位置
內(nèi)置地址譯碼——Avalon總線自動產(chǎn)生所有外設(shè)的片選信號,極大地簡化了基于Avalon總線的外設(shè)的設(shè)計工作
多主設(shè)備總線結(jié)構(gòu)——Avalon總線上可以包含多個主外設(shè),并自動生成仲裁邏輯
采用向?qū)椭脩襞渲孟到y(tǒng)——SOPC Builder提供圖形化的向?qū)椭脩暨M行總線配置(添加外設(shè)、指定主/從關(guān)系、定義地址映像等)。Avalon總線結(jié)構(gòu)將根據(jù)用戶在向?qū)е休斎氲?a target="_blank">參數(shù)自動生成
動態(tài)地址對齊——如果參與傳輸?shù)碾p方總線寬度不一致,Avalon總線自動處理數(shù)據(jù)傳輸?shù)募毠?jié),使得不同數(shù)據(jù)總線寬度的外設(shè)能夠方便地連接
Avalon 總線模塊為外設(shè)提供的服務(wù)
Avalon 總線模塊為連接到總線的Avalon 外設(shè)提供了以下的服務(wù):
數(shù)據(jù)通道多路轉(zhuǎn)換——Avalon 總線模塊的多路復(fù)用器從被選擇的從外設(shè)向相關(guān)主外設(shè)傳輸數(shù)據(jù)。
地址譯碼——地址譯碼邏輯為每一個外設(shè)提供片選信號。這樣,單獨的外設(shè)不需要對地址線譯碼以產(chǎn)生片選信號,從而簡化了外設(shè)的設(shè)計。
產(chǎn)生等待狀態(tài)(Wait-State)——等待狀態(tài)的產(chǎn)生拓展了一個或多個周期的總線傳輸,這有利于滿足某些特殊的同步外設(shè)的需要。當從外設(shè)無法在一個時鐘周期內(nèi)應(yīng)答的時候,產(chǎn)生的等待狀態(tài)可以使主外設(shè)進入等待狀態(tài)。在讀使能及寫使能信號需要一定的建立時間/保持時間要求的時候也可以產(chǎn)生等待狀態(tài)。
動態(tài)總線寬度——動態(tài)總線寬度隱藏了窄帶寬外設(shè)與較寬的Avalon 總線(或者Avalon 總線與更高帶寬的外設(shè))相接口的細節(jié)問題。舉例來說,一個32 位的主設(shè)備從一個16 位的存儲器中讀數(shù)據(jù)的時候,動態(tài)總線寬度可以自動的對16 位的存儲器進行兩次讀操作,從而傳輸32 位的數(shù)據(jù)。這便減少了主設(shè)備的邏輯及軟件的復(fù)雜程度,因為主設(shè)備不需要關(guān)心外設(shè)的物理特性。
中斷優(yōu)先級(Interrupt-Priority)分配——當一個或者多個從外設(shè)產(chǎn)生中斷的時候,Avalon 總線模塊根據(jù)相應(yīng)的中斷請求號(IRQ)來判定中斷請求。
延遲傳輸(Latent Transfer)能力——在主、從設(shè)備之間進行帶有延遲傳輸?shù)倪壿嫲贏valon總線模塊的內(nèi)部。
流式讀寫(Streaming Read and Write)能力——在主、從設(shè)備之間進行流傳輸使能的邏輯包含于Avalon 總線模塊的內(nèi)部。
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原文標題:Avalon總線概述
文章出處:【微信號:ALIFPGA,微信公眾號:FPGA極客空間】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。
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