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時序分析的基本概念ETM的詳細(xì)介紹及如何應(yīng)用的資料概述

數(shù)字后端IC芯片設(shè)計(jì) ? 來源:未知 ? 作者:易水寒 ? 2018-09-24 19:30 ? 次閱讀

今天我們要介紹的時序分析概念是ETM。全稱extracted timing model。這是在層次化設(shè)計(jì)中必須要使用的一個時序模型文件。由block owner產(chǎn)生,在頂層設(shè)計(jì)使用。

當(dāng)block owner做完P(guān)R以后,需要將block邊界上的timing信息抽取出來,存放成一個timing lib文件。這個lib文件就是ETM文件。可以將做完P(guān)R的block理解為一個Macro,ETM就是該Macro的lib文件。頂層讀入每個block的ETM文件后,就能看到block邊界上的timing信息。根據(jù)設(shè)計(jì)階段的不同,我們可以在preCTS, postCTS以及postRoute之后分別抽取ETM供頂層人員使用,當(dāng)然越往后階段的ETM越精確.

來看看ETM文件里有什么內(nèi)容:

boundary timing arc:包括in2reg,reg2out,in2out三種timing path的信息,reg2reg的path會被忽略

1) In2reg:

存入ETM中的是setup和hold的arc

Setup arc = data path delay (input to FF) + FF setup value – clock path delay

Hold arc value = data path delay (input to FF) - FF hold value – clock path delay

2) Reg2Out

存入ETM中的是時序邏輯的延遲

時序邏輯延遲 = delay (CLK到CK pin) + delay (CK pin到output port).

3) In2Out

存入ETM中的是組合邏輯的延遲

組合邏輯延遲 = Path delay

當(dāng)然,ETM model里還會保存很多內(nèi)容,比如

Design rule(max fanout, max_transition, max_cap)

Clocks(包括create_clock和generate clock)

Path Exceptions, case constant等,大家有興趣可以去研究下。

使用方法

PT:extract_model

extract_model -library_cell -output model2 -format {db}

EDI:do_extract_model

do_extract_model -cell_name test_model -library_name test_lib test.lib

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
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原文標(biāo)題:時序分析基本概念介紹

文章出處:【微信號:IC_Physical_Design,微信公眾號:數(shù)字后端IC芯片設(shè)計(jì)】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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