本文提出了一種基于SoPC的FPGA在線測(cè)試方法，是對(duì)現(xiàn)有FPGA在線測(cè)試方法的一種有效的補(bǔ)充。

　　1 在線測(cè)試數(shù)據(jù)操作流程

　　基于SoPC的FPGA在線測(cè)試方法的數(shù)據(jù)操作流程如圖1所示。如果用戶需要采集FPGA的測(cè)試數(shù)據(jù)并且上傳至PC機(jī)，則用戶首先要將被測(cè)試數(shù)據(jù)寫入DMA讀從外設(shè)，然后系統(tǒng)自動(dòng)啟動(dòng)DMA控制器，將數(shù)據(jù)送入Nios II的數(shù)據(jù)存儲(chǔ)器。再由JTAG UART控制器經(jīng)JTAG接口上傳至Nios II IDE(NiosⅡIntegrated Development Environment，Nios II開發(fā)環(huán)境)，Nios II IDE將接收到的數(shù)據(jù)寫入測(cè)量數(shù)據(jù)存儲(chǔ)文件，從而完成了FPGA測(cè)試數(shù)據(jù)的上傳。如果用戶需要將PC機(jī)中的激勵(lì)數(shù)據(jù)文件下載至FPGA，則系統(tǒng)首先在Nios II IDE中通過Host-Based File System讀出激勵(lì)文件數(shù)據(jù)，然后由JTAG接口經(jīng)JTAG UART控制器下載至Nios II處理器的數(shù)據(jù)存儲(chǔ)器，Nios II發(fā)起DMA寫傳輸把數(shù)據(jù)從數(shù)據(jù)存儲(chǔ)器搬運(yùn)至DMA寫從外設(shè)并寫入FPGA片上FIFO，從而完成了激勵(lì)數(shù)據(jù)的下載。

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　　2 SoPC平臺(tái)架構(gòu)

　　SoPC系統(tǒng)部件組成見圖2，系統(tǒng)包括Nios II處理器、On-Chip RAM、JTAG UART、EPCS控制器，SYSID、定時(shí)器、DMA讀控制器dma_0、DMA寫控制器dam_1，以及自定義DMA讀從外設(shè)fifo_control與自定義DMA寫從外設(shè)ext_rdfifo_controller。NiosⅡ的復(fù)位地址為EPCS控制器，異常地址為On_ChipRAM。DMA讀控制器的讀主端口連接至自定義DMA讀從外設(shè)，寫主端口連接至On-Chip RAM，DMA寫控制器的讀主端口連接至On-Chip RAM，寫主端口連接至自定義DMA寫從外設(shè)。系統(tǒng)的JTAG UART主要實(shí)現(xiàn)JTAG接口的控制，使FPGA能夠通過JTAG接口與PC機(jī)進(jìn)行通信。

　　3 DMA讀、寫從外設(shè)的設(shè)計(jì)

　　測(cè)試數(shù)據(jù)在DMA控制器讀數(shù)據(jù)之前是存儲(chǔ)在片上FIFO的，而激勵(lì)數(shù)據(jù)是通過DMA控制器寫入片上FIFO的。然而DMA控制器數(shù)據(jù)讀、寫主端口采用的是Avalon存儲(chǔ)器映射接口(Avalon Memory Mapped Interface，Avalon-MM接口)，不能直接對(duì)FIFO進(jìn)行操作，Altera公司也沒有提供相應(yīng)的控制器核，需要用戶自己開發(fā)DMA讀從外設(shè)用于控制FIFO把測(cè)試數(shù)據(jù)傳送給DMA控制器，以及DMA寫從外設(shè)用于控制FIFO接收DMA控制器的激勵(lì)數(shù)據(jù)。本文開發(fā)的DMA讀從外設(shè)模塊結(jié)構(gòu)框圖如圖3所示。

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　　DMA讀從外設(shè)包括了3個(gè)端口，即控制從端口、DMA從端口以及FIFO寫端口。DMA讀從外設(shè)的控制從端口包括3個(gè)寄存器，分別是狀態(tài)寄存器status、控制寄存器control、FIFO已使用字?jǐn)?shù)寄存器usedw。NiosⅡ通過讀/寫這些寄存器獲取此外設(shè)的狀態(tài)以及實(shí)現(xiàn)對(duì)此外設(shè)的控制。另外，控制端口還包含了中斷接口用于此外設(shè)向NiosⅡ發(fā)起中斷請(qǐng)求。DMA讀從外設(shè)產(chǎn)生中斷請(qǐng)求有2種情況：一是內(nèi)部FIFO寫滿;二是收到外部測(cè)試數(shù)據(jù)的包結(jié)束信號(hào)。此時(shí)，即使FIFO未寫滿，DMA讀從外設(shè)也會(huì)發(fā)起中斷請(qǐng)求，從而實(shí)現(xiàn)采集的測(cè)試數(shù)據(jù)的立即傳輸。DMA從端口采用帶流控制信號(hào)的AvalonMM總線，用于實(shí)現(xiàn)DMA控制器的測(cè)試數(shù)據(jù)讀操作;管道接口是測(cè)試數(shù)據(jù)寫入此外設(shè)的FIFO接口，包括數(shù)據(jù)總線、寫有效信號(hào)和一些狀態(tài)信號(hào)(如FIFO寫滿信號(hào)等)。DMA寫從外設(shè)的結(jié)構(gòu)與DMA讀從外設(shè)類似，只是沒有中斷請(qǐng)求信號(hào)，這里不再詳述。