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      電子發(fā)燒友網(wǎng)>電子資料下載>電子教材>高速數(shù)據(jù)包處理硬件加速技術(shù)

      高速數(shù)據(jù)包處理硬件加速技術(shù)

      2011-05-28 | pdf | 426 KB | 次下載 | 免費

      資料介紹

      ?

      鏈路帶寬的劇增給高速網(wǎng)絡(luò)數(shù)據(jù)包處理帶來了極大的挑戰(zhàn)。傳統(tǒng)的純軟件網(wǎng)絡(luò)數(shù)據(jù)包處理在性能上已不能滿足需要。當(dāng)前網(wǎng)絡(luò)處理器、多核芯片等針對高性能網(wǎng)絡(luò)數(shù)據(jù)包處理提供了件加速技術(shù)，對多數(shù)網(wǎng)絡(luò)應(yīng)用提供了高性能實現(xiàn)方法。在對數(shù)據(jù)處理時延、吞吐量、丟包率等性能指標有更高要求的應(yīng)用場合，還需要專用的加速硬件。本文針對基于深度報文檢測（DPI）的高性能流量分析和控制應(yīng)用需求，介紹基于現(xiàn)場可編程邏輯門陣列（FPGA）的通用高速網(wǎng)絡(luò)數(shù)據(jù)包處理硬件加速架構(gòu)。該架構(gòu)對數(shù)據(jù)采集通路進行硬件加速，實現(xiàn)了高速鏈路數(shù)據(jù)報文的線速采集，通過專用硬件進行數(shù)據(jù)包轉(zhuǎn)發(fā)和流量控制，針對后端多核服務(wù)器的并行處理進行優(yōu)化，實現(xiàn)了控制和分析平面的高性能處理。本文介紹該架構(gòu)在流量采集、高精度時鐘同步、高速包分類和流量控制等方面的硬件加速方法。測試結(jié)果表明，這些加速方法充分卸載了服務(wù)器的處理負荷，能有效地提高應(yīng)用系統(tǒng)的性能。
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