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      電子發(fā)燒友網(wǎng)>電子資料下載>電子書籍>納米級(jí)工藝下多處理器功耗評(píng)估與優(yōu)化技術(shù)

      納米級(jí)工藝下多處理器功耗評(píng)估與優(yōu)化技術(shù)

      2008-11-14 | rar | 305 | 次下載 | 免費(fèi)

      資料介紹

      摘要：隨著處理器設(shè)計(jì)進(jìn)入納米級(jí)工藝，功耗不可避免地成為阻礙摩爾定律繼續(xù)快速前進(jìn)的主要因素之一。與此同時(shí)片上多核處理器（Chip Multiple Processors--CMP）已成為當(dāng)今處理器設(shè)計(jì)的主流。本文主要從體系結(jié)構(gòu)設(shè)計(jì)的角度，對(duì)納米級(jí)工藝下片上多核處理器的功耗評(píng)估方法及不同構(gòu)件的低功耗技術(shù)進(jìn)行概括性介紹，為目前片上多核處理器的結(jié)構(gòu)設(shè)計(jì)提供參考。
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