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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于CPLD的脈沖信號(hào)發(fā)生器的設(shè)計(jì)

      基于CPLD的脈沖信號(hào)發(fā)生器的設(shè)計(jì)

      2010-12-09 | rar | 964 | 次下載 | 10積分

      資料介紹

      提出了基于復(fù)雜可編程邏輯器件(Complex Programmable Logic Device, CPLD)16位的全數(shù)字脈沖信號(hào)發(fā)生器的設(shè)計(jì)，可產(chǎn)生周期、占空比均可調(diào)的高穩(wěn)定性脈沖。此設(shè)計(jì)方法可用于DDS函數(shù)信號(hào)發(fā)生器中脈沖信號(hào)的產(chǎn)生，采用單片機(jī)控制CPLD工作。
      Abstract:
      ?The design of digital 16-bit pulse signal generator based on CPLD is presented,which produces period and duty factor all adjustable and high stability pulse.This method can be used as the creation of pulse in the DDS function signal generator.In the design the singlechip can control CPLD.
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