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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA視頻教程之為什么Verilog能支持大型設(shè)計的詳細資料說明

      FPGA視頻教程之為什么Verilog能支持大型設(shè)計的詳細資料說明

      2019-03-27 | rar | 6.05 MB | 次下載 | 免費

      資料介紹

      　　為什么Verilog能支持大型設(shè)計

      　　Verilog語法支持多層次多模塊設(shè)計：-用、include宏指令可以在一個模塊中包含多個模塊;

      　　在一個模塊中可以用實例調(diào)用別的模塊中定義的電路結(jié)構(gòu)，構(gòu)成多層次模塊：

      　　在一個模塊中可以用多個任務(wù)和函數(shù)來表達復(fù)雜的狀態(tài)機和結(jié)構(gòu);

      　　一個設(shè)計項目往往由一個頂層測試模塊和多個可綜合模塊和若千個外圍接口模塊構(gòu)成。

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