FPGA入門系列實(shí)驗(yàn)教程之使用FPGA實(shí)現(xiàn)數(shù)碼管動(dòng)態(tài)顯示的資料免費(fèi)下載
資料介紹
1.實(shí)驗(yàn)任務(wù)
實(shí)現(xiàn)開發(fā)板上 8 個(gè)數(shù)碼管動(dòng)態(tài)顯示 0~7。通過(guò)這個(gè)實(shí)驗(yàn),掌握采用 Verilog HDL語(yǔ)言編程實(shí)現(xiàn) 7 段數(shù)碼管顯示譯碼器以及數(shù)碼管動(dòng)態(tài)掃描顯示的方法。
2. 實(shí)驗(yàn)環(huán)境
硬件實(shí)驗(yàn)環(huán)境為艾米電子工作室型號(hào) EP2C8Q208C8 增強(qiáng)版開發(fā)套件。軟件實(shí)驗(yàn)環(huán)境為 Quartus II 8.1 開發(fā)軟件。
3. 實(shí)驗(yàn)原理
由于LED靜態(tài)顯示需要占用較多的I/O口,且功耗較大,因此在大多數(shù)場(chǎng)合通常不采用靜態(tài)顯示,而采用動(dòng)態(tài)掃描的方法來(lái)控制LED數(shù)碼管的顯示。動(dòng)態(tài)顯示的特點(diǎn)是將所有位數(shù)碼管的段選線并聯(lián)在一起,由位選線控制是哪一位數(shù)碼管有效。點(diǎn)亮數(shù)碼管采用動(dòng)態(tài)掃描顯示。所謂動(dòng)態(tài)掃描顯示即輪流向各位數(shù)碼管送出字形碼和相應(yīng)的位選,只要掃描顯示速度夠快,利用發(fā)光管的余輝和人眼視覺(jué)暫留作用,使人的感覺(jué)好像各位數(shù)碼管同時(shí)都在顯示。動(dòng)態(tài)顯示的亮度比靜態(tài)顯示要差一些,所以在選擇限流電阻時(shí)應(yīng)略小于靜態(tài)顯示電路中的。動(dòng)態(tài)掃描顯示時(shí)刷新頻率最好大于50HZ,即沒(méi)顯示一輪的時(shí)間不超過(guò)20ms,每個(gè)數(shù)碼管顯示時(shí)間不能太長(zhǎng)也不能太短,時(shí)間太長(zhǎng)會(huì)影響刷新率,導(dǎo)致總體顯示呈現(xiàn)閃爍的現(xiàn)象,時(shí)間太短發(fā)光二極管的電流導(dǎo)通時(shí)間也就短,會(huì)影響總體的顯示亮度。一般控制在1ms左右最佳。
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