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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>便攜式IP核的WISHBONE片上系統(tǒng)SoC互連結(jié)構(gòu)

便攜式IP核的WISHBONE片上系統(tǒng)SoC互連結(jié)構(gòu)

2021-01-19 | rar | 0.88 MB | 次下載 | 免費(fèi)

資料介紹

  用于便攜式IP核的WISHBONE1片上系統(tǒng)(SoC)互連結(jié)構(gòu)是一種靈活的設(shè)計(jì)方法,可用于半導(dǎo)體IP核。其目的是通過(guò)緩解片上系統(tǒng)集成問(wèn)題來(lái)促進(jìn)設(shè)計(jì)重用。這是通過(guò)在IP核之間創(chuàng)建一個(gè)公共接口來(lái)實(shí)現(xiàn)的。這提高了系統(tǒng)的可移植性和可靠性,并縮短了最終用戶的上市時(shí)間。

  以前,IP核使用非標(biāo)準(zhǔn)的互連方案,這使得它們很難集成。

  這需要?jiǎng)?chuàng)建自定義的粘合邏輯來(lái)將每個(gè)核心連接在一起。通過(guò)采用標(biāo)準(zhǔn)的互連方案,最終用戶可以更快、更容易地集成核心。

  本規(guī)范可用于軟核、固核或硬核IP。由于硬核和硬核通常被認(rèn)為是軟核,所以本規(guī)范就是從這個(gè)角度編寫(xiě)的。

  本規(guī)范不要求使用特定的開(kāi)發(fā)工具或目標(biāo)硬件。此外,它完全符合幾乎所有的邏輯綜合工具。然而,規(guī)范中給出的示例確實(shí)使用VHDL硬件描述語(yǔ)言。這些僅為方便讀者而提供,其他硬件描述語(yǔ)言(如Verilog?)的用戶應(yīng)易于理解。也可以使用基于原理圖的工具。

  叉形桿互連旨在作為通用接口。因此,它定義了IP核心模塊之間的標(biāo)準(zhǔn)數(shù)據(jù)交換。它并不試圖規(guī)范IP核心的特定于應(yīng)用程序的功能。

  WISHBONE建筑師受到三個(gè)因素的強(qiáng)烈影響。首先,需要一個(gè)好的、可靠的片上系統(tǒng)集成解決方案。第二,需要一個(gè)通用的接口規(guī)范來(lái)促進(jìn)大型項(xiàng)目團(tuán)隊(duì)的結(jié)構(gòu)化設(shè)計(jì)方法。

  第三,他們對(duì)PCI總線和VMEbus等微機(jī)總線提供的傳統(tǒng)系統(tǒng)集成解決方案印象深刻。

  事實(shí)上,叉形桿結(jié)構(gòu)類似于微型計(jì)算機(jī)總線,因?yàn)樗鼈兌迹?/p>

 ?。╝) 提供靈活的集成解決方案,可以輕松地針對(duì)特定的應(yīng)用程序進(jìn)行定制;(b)提供各種總線周期和數(shù)據(jù)路徑寬度,以解決各種系統(tǒng)問(wèn)題;(c)允許各種供應(yīng)商設(shè)計(jì)產(chǎn)品(從而降低價(jià)格,同時(shí)提高性能和質(zhì)量)。
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