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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實現(xiàn)高速圖像存儲系統(tǒng)中的SDRAM控制器

      如何使用FPGA實現(xiàn)高速圖像存儲系統(tǒng)中的SDRAM控制器

      2021-01-26 | rar | 0.36 MB | 次下載 | 免費

      資料介紹

      　　SDRAM作為大容量存儲器在高速圖像處理中具有很大的應(yīng)用價值。但由于SDRAM的結(jié)構(gòu)和SRAM不同，其控制比較復(fù)雜。文章詳細介紹了 SDRAM存儲器的結(jié)構(gòu)、接口信號和操作方法，以及 SDRAM控制器的設(shè)計方法。結(jié)合實際系統(tǒng)，設(shè)計給出了使用FPGA實現(xiàn) SDRAM控制器的硬件接口，在 Altera公司的主流FPGA芯片EPlC6Q240C8上，通過增加流水級數(shù)和將輸出觸發(fā)器布置在IO單元中，該控制器可達到185MHz的頻率。

      　　在高速圖像采集和存儲系統(tǒng)中需要海量數(shù)據(jù)的暫時存儲，即大的中間緩存，使用 SDRAM作為數(shù)據(jù)緩存是一種非常有效的方法。 SDRAM作數(shù)據(jù)緩存不僅具有大容量和高速度的特點，而且在價格和功耗方面也占有很大的優(yōu)勢。由于SDRAM的基本存儲單元是基于三極管和電容的，這與普通的基于觸發(fā)器的SRAM的存儲結(jié)構(gòu)有較大差異，因此其控制機制比較復(fù)雜。雖然目前的微處理器或許多DSP都具有和 SDRAM的直接接口，但是這種接口的效率并不高，并不適合作為高速圖像存儲系統(tǒng)的應(yīng)用。鑒于以上情況，木文介紹了在高速圖像采集和存儲系統(tǒng)中采用了SDRAM作為主要數(shù)據(jù)緩沖存儲器，并設(shè)計了基于FPGA的 SDRAM控制器的方法，綜合及仿真結(jié)果表明，在 Altera公司的主流芯片 Cyclone（EPlC6Q240C8）上，該 SDRAM控制器的最高頻率可達到185MH

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