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數(shù)字系統(tǒng)設(shè)計與VerilogHDL根據(jù)EDA課程教學(xué)要求，以提高數(shù)字設(shè)計能力為目的，系統(tǒng)闡述數(shù)字系統(tǒng)開發(fā)的相關(guān)知識，主要內(nèi)容包括EDA技術(shù)、FPGA/CPLD器件、Verilog硬件描述語言等。全書以QuartusⅡ、SynplifyPro軟件為平臺，以Verilog—1995和Verilog—2001語言標(biāo)準(zhǔn)為依據(jù)，以可綜合的設(shè)計為重點，通過大量經(jīng)過驗證的數(shù)字設(shè)計實例，系統(tǒng)闡述數(shù)字系統(tǒng)設(shè)計的方法與技術(shù)，由淺入深地介紹Verilog工程開發(fā)的知識與技能。
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