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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>基于PDN共振峰的最壞情況數(shù)據(jù)模式分析電源完整性對(duì)FPGA DDR4存儲(chǔ)器接口中的信號(hào)完整性的影響

      基于PDN共振峰的最壞情況數(shù)據(jù)模式分析電源完整性對(duì)FPGA DDR4存儲(chǔ)器接口中的信號(hào)完整性的影響

      2023-09-13 | pdf | 5.36 MB | 次下載 | 免費(fèi)

      資料介紹

      在基于供電網(wǎng)絡(luò) (PDN) 的共振峰創(chuàng)建的布局前、布局后和系統(tǒng)驗(yàn)證數(shù)據(jù)模式中分析電源完整性對(duì) FPGA DDR4 存儲(chǔ)器接口中的信號(hào)完整性的影響。使用 FPGA 配置的矢量網(wǎng)絡(luò)分析儀 (VNA) 測(cè)量 PDN 阻抗曲線。創(chuàng)建多 個(gè)測(cè)試數(shù)據(jù)模式，以便將電源的電流頻譜分量與 PDN 共振峰疊加在一起，并演練傳輸線多次反射累積效 應(yīng)。然后將這些數(shù)據(jù)模式用于識(shí)別導(dǎo)致信號(hào)完整性衰減的主導(dǎo)因素。
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