資料介紹
分析安全關(guān)鍵領(lǐng)域的時間觸發(fā)網(wǎng)絡(luò)協(xié)議 SAE AS6802與時間同步算法技術(shù),分別對同步流程、時間同步角色、時序保持算法、集中控制算法、時鐘糾正算法、同/異步派系檢測算法以及通道擇優(yōu)方法等進(jìn)行研究,歸納時間同步精度的影響因素。在此基礎(chǔ)上,設(shè)計一種時間同步算法IP核,并構(gòu)建基于 System Verilog的模塊化仿真驗證平臺。利用該平臺對時間同步算法進(jìn)行RTL級仿真,結(jié)果驗證了該時間同步算法的正確性,其同步精度保持在亞微秒級,滿足下一代高安全關(guān)鍵領(lǐng)域的應(yīng)用要求。
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