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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術(shù)論文>一種新穎的圖像縮放算法進(jìn)行FPGA硬件實(shí)現(xiàn)

      一種新穎的圖像縮放算法進(jìn)行FPGA硬件實(shí)現(xiàn)

      2017-12-12 | rar | 0.65 MB | 次下載 | 1積分

      資料介紹

      　　本文選擇了一種新穎的圖像縮放算法進(jìn)行FPGA硬件實(shí)現(xiàn)。該算法基于奇偶分解的思想，具有復(fù)雜度低、硬件需求小和縮放效果良好等突出優(yōu)點(diǎn)。首先利用MATLAB對該算法進(jìn)行了功能驗(yàn)證，然后用縮放耗時(shí)、PSNR、邊緣模糊等級和脈沖噪聲等指標(biāo)評估基于該算法圖像處理效果。與傳統(tǒng)時(shí)域算法作對比，對比結(jié)果表明該算法在處理效果和運(yùn)算速度上的優(yōu)異性?；赯edboard開發(fā)板，運(yùn)用Vivado HLS高級綜合工具將算法的C程序綜合成硬件IP，并搭建了包含ARM處理器和VGA等模塊的軟硬協(xié)同驗(yàn)證系統(tǒng)。實(shí)驗(yàn)驗(yàn)證了圖像縮放算法硬件設(shè)計(jì)的正確性和實(shí)用性。

      一種新穎的圖像縮放算法進(jìn)行FPGA硬件實(shí)現(xiàn)

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