資料介紹
??????? 基于SOC(system on chip)技術(shù),利用VHDL 語(yǔ)言設(shè)計(jì)開發(fā)具有奇偶校
驗(yàn)功能、數(shù)據(jù)位和波特率可調(diào)的通用異步串行通信接口IP 核。該IP 核內(nèi)置異步
接收和發(fā)送模塊,可直接提供給其它SOC 系統(tǒng)設(shè)計(jì)者使用,減少SOC 系統(tǒng)設(shè)計(jì)的
工作量。
關(guān)鍵字: SOC VHDL 奇偶校驗(yàn) 波特率可調(diào)
??????? SOC 的核心思想是IP 核復(fù)用,IP 核是設(shè)計(jì)者提供的具有特定功能和相關(guān)參數(shù)
描述的模塊。為了加快SOC 芯片的設(shè)計(jì)速度,可將己有的專用IP 核在SOC 設(shè)計(jì)
中調(diào)用,從而簡(jiǎn)化設(shè)計(jì),減少工作量。本文介紹利用VHDL 語(yǔ)言開發(fā)一個(gè)可復(fù)
用的通用異步串行通信接口IP 核。該IP 核內(nèi)置控制寄存器,通過(guò)寫入控制字節(jié)
設(shè)定UART 具體工作模式(設(shè)定波特率、選擇有效數(shù)據(jù)位數(shù)以及是否采用奇偶
校驗(yàn)位),增加該IP 核的通用性和可移植性。
驗(yàn)功能、數(shù)據(jù)位和波特率可調(diào)的通用異步串行通信接口IP 核。該IP 核內(nèi)置異步
接收和發(fā)送模塊,可直接提供給其它SOC 系統(tǒng)設(shè)計(jì)者使用,減少SOC 系統(tǒng)設(shè)計(jì)的
工作量。
關(guān)鍵字: SOC VHDL 奇偶校驗(yàn) 波特率可調(diào)
??????? SOC 的核心思想是IP 核復(fù)用,IP 核是設(shè)計(jì)者提供的具有特定功能和相關(guān)參數(shù)
描述的模塊。為了加快SOC 芯片的設(shè)計(jì)速度,可將己有的專用IP 核在SOC 設(shè)計(jì)
中調(diào)用,從而簡(jiǎn)化設(shè)計(jì),減少工作量。本文介紹利用VHDL 語(yǔ)言開發(fā)一個(gè)可復(fù)
用的通用異步串行通信接口IP 核。該IP 核內(nèi)置控制寄存器,通過(guò)寫入控制字節(jié)
設(shè)定UART 具體工作模式(設(shè)定波特率、選擇有效數(shù)據(jù)位數(shù)以及是否采用奇偶
校驗(yàn)位),增加該IP 核的通用性和可移植性。
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