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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的FFT處理器的研究與設(shè)計(jì)

      基于FPGA的FFT處理器的研究與設(shè)計(jì)

      2010-01-20 | rar | 221 | 次下載 | 5積分

      資料介紹

      本文利用頻域抽取基四算法，運(yùn)用靈活的硬件描述語言-Verilog HDL 作為設(shè)
      計(jì)主體，設(shè)計(jì)并實(shí)現(xiàn)一套集成于FPGA 內(nèi)部的FFT 處理器。FFT 處理器的硬件試驗(yàn)
      結(jié)果表明該處理器的運(yùn)算結(jié)果正確，并且具有較高運(yùn)算速度。該方法具有設(shè)計(jì)簡單
      靈活，體積小等優(yōu)點(diǎn)，可用于雷達(dá)處理、高速圖像處理和數(shù)字通信等應(yīng)用場合。
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