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隨著 FPGA 的設計速度、尺寸和復雜度明顯增長，使得整個設計流程中的實時驗證和調試成為當前FPGA 系統(tǒng)的關鍵部分。獲得FPGA 內部信號有限、FPGA 封裝和印刷電路板(PCB)電氣噪聲，這一切使得設計調試和檢驗變成設計周期中最困難的流程。另一方面，幾乎當前所有的像CPU、DSP、ASIC 等高速芯片的總線，除了提供高速并行總線接口外，正迅速向高速串行接口的方向發(fā)展，F(xiàn)PGA 也不例外，每一條物理鏈路的速度從600Mbps 到高達10Gbps，高速I/O 的測試和驗證更成為傳統(tǒng)專注于FPGA 內部邏輯設計的設計人員面臨的巨大挑戰(zhàn)。這些挑戰(zhàn)使設計人員非常容易會把絕大部分設計周期時間放在調試和檢驗設計上。
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