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賽靈思技術(shù)

FPGA對顯示接口與面板有何作用

HDR 內(nèi)容和顯示實際上包括三個考慮因素：動態(tài)范圍、光電/電光傳遞函數(shù)(OETF/EOTF) 和寬色域。 HDR 提供了從黑色到白色的更大范圍，或通...

2024-04-01 標簽：FPGA asic 賽靈思 453 0

FPGA的基本構(gòu)成

目前市場上的主流FPGA供應商主要有賽靈思和英特爾兩家，F(xiàn)PGA的基本構(gòu)成對于不同廠家來說基本類同，英特爾Cyclone IV系列邏輯單元（LE）基本構(gòu)成如下。

2023-11-08 標簽：fpga 英特爾寄存器 875 0

如何正確應用FPGA的四種時鐘資源？

把握DCM、PLL、PMCD和MMCM知識是穩(wěn)健可靠的時鐘設計策略的基礎。賽靈思在其FPGA中提供了豐富的時鐘資源，大多數(shù)設計人員在他們的FPGA設計中...

2023-10-30 標簽：fpga 賽靈思 pll 1749 0

100G以太網(wǎng)為8K有效負載做好準備

借助最新設備，8K 超高清（ 8K UHD ）在專業(yè)人士和消費者群體中正愈發(fā)普及。在此前的博客中，我們探討了身處更大規(guī)模的沉浸式媒體技術(shù)的前沿，8K 分...

2023-08-23 標簽：以太網(wǎng)賽靈思 Xilinx 918 0

fpga系列產(chǎn)品的漏洞機理分析

? AMD-XILINX FPGA密鑰存儲支持兩種模式： 1）BBRAM電池供電存儲已有公開文獻發(fā)表，可通過激光注入讀取BBRAM中保存的明文密鑰，且...

2023-07-28 標簽：fpga 賽靈思信號處理 1177 0

Vivado設計套件助力快速編譯設計并達到性能目標

Suhel?Dhanani AMD 自適應 SoC 與 FPGA 事業(yè)部軟件營銷總監(jiān) 在設計規(guī)模和復雜性不斷增長的世界里，SoC 和 FPGA 設計需要...

2023-07-12 標簽：fpga amd 賽靈思 989 0

如何理解FPGA的配置狀態(tài)字寄存器

賽靈思的FPGA有多種配置接口，如SPI，BPI，SeletMAP，Serial，JTAG等；如果從時鐘發(fā)送者的角度分，還可以分為主動Master（即由...

2023-02-16 標簽：fpga 寄存器接口 2130 0

賽靈思FPGA上電配置流程的8個步驟

加載配置幀后，比特流指示設備進入啟動序列。啟動序列由8相（0-7階段）順序狀態(tài)機控制。啟動順控程序執(zhí)行下表中列出的任務。每個啟動事件的特定階段是用戶可編程的。

2023-02-13 標簽：fpga 賽靈思 6064 0

如何使用Vivado 2022.1版本工具鏈實現(xiàn)ZCU102 USB啟動(上)

本文依據(jù) Vivado 2022.1 版本工具鏈的特性，對 UG1209（最新版本為 2020.1 ）中介紹的 USB BOOT 啟動步驟做了修改，...

2022-10-28 標簽：usb 賽靈思 Vivado 2334 0

mMIMO有源天線單元結(jié)構(gòu)設計

AAU中的天線的性能特征包括增益、等效全向輻射功率(EIRP)、旁瓣電平、轉(zhuǎn)向角和仰角傾斜。

2022-10-11 標簽：天線賽靈思 RF 1665 0

在VCK190板子上使用DDR4-DIMM的ECC

在Vivado 2021.2的VCK190 boardfile里DDR4-DIMM的DQ width被限制為64bit，不能使能ECC功能。如果需要在V...

2022-08-17 標簽：賽靈思 DDR4 ECC 1298 0

如何配置Petalinux工程來從Flash啟動Linux Kernel

新版petalinux生成的u-boot是通過boot.scr來加載linux kernel的。如果我們用petalinux工程默認配置和下面命令生成b...

2022-08-10 標簽：FlaSh 賽靈思 Linux 2227 0

異構(gòu)平臺設計方法探索賽靈思Versal ACAP設計方法論

身處智能時代，科技發(fā)展日新月異，伴隨數(shù)據(jù)中心、有線網(wǎng)絡、5G 無線和汽車等愈加豐富的場景，相應的技術(shù)與功能也正經(jīng)歷飛速迭代，因此，單一計算架構(gòu)已難以應對...

2022-08-02 標簽：賽靈思異構(gòu)平臺 Versal 993 0

在u-boot中使用ethernet的方法

KV260 petalinux BSP在u-boot device tree中disable了GEM3，也就是說ethernet在u-boot中不建議使...

2022-07-21 標簽：賽靈思 u-boot Ethernet 3909 0

賽靈思FFT IP中的縮放因子說明

賽靈思 Fast Fourier Transform (FFT) IP 具有專用于處理 FFT 輸出中的位增長的縮放因子。本文旨在提供有關此 IP 中可...

2022-07-20 標簽：賽靈思 IP FFT 5028 0

對dump出的寄存器進行分析

QDMA的驅(qū)動在進行版本升級時，可能會對部分寄存器的數(shù)值進行變更，用戶如果要進行升級，推薦升級到最新的Vivado和驅(qū)動版本。如果驅(qū)動和Vivado之間...

2022-07-14 標簽：寄存器賽靈思 driver 1914 0

如何用ChipScopy創(chuàng)建并運行l(wèi)ink sweep

這個Demo將介紹如何用ChipScopy創(chuàng)建并運行l(wèi)ink sweep。

2022-07-10 標簽：賽靈思 Link python 1198 0

如何使用AXI VIP在AXI4(Full)主接口中執(zhí)行驗證和查找錯誤

在 AXI 基礎第 2 講一文中，曾提到賽靈思 Verification IP (AXI VIP) 可用作為 AXI 協(xié)議檢查工具。在本次第4講中，我...

2022-07-08 標簽：接口賽靈思 AXI 2891 0

AXI VIP設計示例 AXI接口傳輸分析

賽靈思 AXI Verification IP (AXI VIP) 是支持用戶對 AXI4 和 AXI4-Lite 進行仿真的 IP。它還可作為 AXI...

2022-07-08 標簽：接口賽靈思仿真 1792 0

Vitis HLS工具簡介及設計流程

Vitis HLS 是一種高層次綜合工具，支持將 C、C++ 和 OpenCL 函數(shù)硬連線到器件邏輯互連結(jié)構(gòu)和 RAM/DSP 塊上。Vitis HLS...

2022-05-25 標簽：賽靈思 C語言 Vitis 2374 0

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LitePoint為全球最具創(chuàng)新力的無線設備制造商提供無線測試解決方案和服務，幫助他們確保其產(chǎn)品能夠滿足當今高標準的消費者需求。LitePoint是無線測試領域的領先創(chuàng)新企業(yè)，其產(chǎn)品開箱即用，可用于測試全球范圍內(nèi)最廣泛使用的無線芯片組。LitePoint與智能手機、平板電腦、個人電腦、無線接入點和芯片組的領先制造商合作。LitePoint也在新興互聯(lián)設備（物聯(lián)網(wǎng)）測試領域處于前沿。LitePoint總部位于加利福尼亞州硅谷，并在全球設有辦事處，是測試和工業(yè)應用自動化設備領先供應商泰瑞達（Teradyne）（納斯達克股票代碼：TER）的全資子公司。泰瑞達 2019 年營收為 23 億美元，其目前在全球范圍內(nèi)擁有 5，500 名員工。
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