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      標(biāo)簽　>　verilog

      verilog

      +關(guān)注28人關(guān)注

      Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：693個(gè) 瀏覽：110074次 帖子：927個(gè)

      verilog資訊

      verilog的邏輯運(yùn)算符

      verilog的邏輯運(yùn)算符

      寫(xiě)在前面 之前曾經(jīng)整理過(guò)verilog的各類運(yùn)算符的表達(dá)方式，但是在學(xué)習(xí)的過(guò)程中并未深入研究關(guān)于邏輯運(yùn)算符的相關(guān)知識(shí)，導(dǎo)致在實(shí)際使用過(guò)程中錯(cuò)誤頻出，下面...

      2023-09-21 標(biāo)簽：Verilog數(shù)字電路運(yùn)算符 2353 0

      一本Verilog HDL代碼對(duì)應(yīng)電路的書(shū)，助你快速編寫(xiě)可綜合模型

      一本Verilog HDL代碼對(duì)應(yīng)電路的書(shū)，助你快速編寫(xiě)可綜合模型

      J.Bhasker 是IEEE PAR 1364.1 Verilog Synthesis Interoperability Working Group(...

      2023-05-26 標(biāo)簽：Verilog模型 1362 0

      Verilog中的If語(yǔ)句和case語(yǔ)句介紹

      Verilog中的If語(yǔ)句和case語(yǔ)句介紹

      我們?cè)谏弦黄恼轮幸呀?jīng)看到了如何使用程序塊（例如 always 塊來(lái)編寫(xiě)按順序執(zhí)行的 verilog 代碼。 我們還可以在程序塊中使用許多語(yǔ)句來(lái)控...

      2023-05-11 標(biāo)簽：Verilog程序Case 4500 0

      ASIC和FPGA的RTL編碼樣式

      ASIC和FPGA的RTL編碼樣式

      SystemVerilog既是一種硬件設(shè)計(jì)語(yǔ)言，也是一種硬件驗(yàn)證語(yǔ)言。IEEE SystemVerilog官方標(biāo)準(zhǔn)沒(méi)有區(qū)分這兩個(gè)目標(biāo)，也沒(méi)有指定完整Sy...

      2023-03-31 標(biāo)簽：IEEEasic硬件 1720 0

      如何快速生成Verilog代碼文件列表

      另外，該代碼提供了一種操作Windows系統(tǒng)路徑的操作方法，可以簡(jiǎn)單修改一下，用作它用。如找到某種類型的文件或某個(gè)文件進(jìn)行拷貝、轉(zhuǎn)移、修改、刪除等操作。

      2023-01-15 標(biāo)簽：操作系統(tǒng)Verilog代碼 1383 0

      Emacs的verilog-mode介紹

      Emacs的verilog-mode介紹

      Verilog－mode是由Michael McNamara mac＠verilog．com和Wilson Snyder wsnyder＠wsnyder...

      2023-01-24 標(biāo)簽：Verilog代碼編輯器 2483 0

      通過(guò)Verilog實(shí)現(xiàn)對(duì)一個(gè)頻率的任意占空比的任意分頻

      在verilog程序設(shè)計(jì)中，我們往往要對(duì)一個(gè)頻率進(jìn)行任意分頻，而且占空比也有一定的要求這樣的話，對(duì)于程序有一定的要求，現(xiàn)在我在前人經(jīng)驗(yàn)的基礎(chǔ)上做一個(gè)簡(jiǎn)單...

      2023-01-05 標(biāo)簽：fpgaVerilog 2661 0

      為了方便仿真這樣寫(xiě)個(gè)ROM

      系統(tǒng)函數(shù)$readmemh和$readmemb分別用來(lái)讀取十六進(jìn)制文件和二進(jìn)制文件。貌似沒(méi)有讀十進(jìn)制的。txt中的數(shù)據(jù)每行一個(gè)不需要逗號(hào)和最后一個(gè)數(shù)據(jù)后...

      2022-12-21 標(biāo)簽：asicROMVerilog 938 0

      新手學(xué)習(xí)FPGA的入門(mén)之道

      很多開(kāi)發(fā)板的程序?qū)懙暮軤€，筆者也做過(guò)一段時(shí)間的開(kāi)發(fā)板設(shè)計(jì)。筆者覺(jué)得很大程度上，開(kāi)發(fā)板在誤人子弟。不過(guò)原廠提供的正品開(kāi)發(fā)板，代碼很優(yōu)秀的，可以借鑒。

      2022-12-15 標(biāo)簽：fpgaVerilog開(kāi)發(fā)板 1343 0

      Verilog HDL描述的組合邏輯環(huán)在FPGA實(shí)現(xiàn)時(shí)到底有什么問(wèn)題？

      組合反饋環(huán)的時(shí)序分析是無(wú)窮循環(huán)的時(shí)序計(jì)算，綜合、實(shí)現(xiàn)等EDA 工具迫不得已一般必須主動(dòng)割斷其時(shí)序路徑，以完成相關(guān)的時(shí)序計(jì)算。而不同的EDA工具對(duì)組合反饋...

      2022-12-12 標(biāo)簽：fpgaVerilogeda 3550 0

      學(xué)會(huì)這些System Verilog方法，芯片驗(yàn)證入門(mén)沒(méi)問(wèn)題

      一個(gè)掌握Verilog語(yǔ)言的工程師初次看SystemVerilog都會(huì)有這樣的感受，這就是Verilog啊，很容易啊，So easy啊。沒(méi)錯(cuò)，確實(shí)是這樣...

      2022-12-09 標(biāo)簽：VerilogC++芯片驗(yàn)證 3756 0

      如何用AI來(lái)寫(xiě)Verilog代碼？

      可能現(xiàn)在它的功能還并不是很完善，但作為工程師，看到這么強(qiáng)大的功能，不禁有些感慨，我們的核心競(jìng)爭(zhēng)力是什么？如果真的有一天，AI可以幫我們寫(xiě)代碼了，我們?cè)撊プ鍪裁矗?/p>

      2022-12-09 標(biāo)簽：VerilogAI語(yǔ)言模型 1846 0

      modelsim波形仿真的基本操作了解

      在剛接觸modelsim時(shí)，被其繁復(fù)的操作流程所困，一度只能依靠在quartus中修改代碼編譯后再重啟modelsim，自動(dòng)導(dǎo)入才能得到波形。這樣的操作...

      2022-11-29 標(biāo)簽：仿真Verilog代碼 3326 0

      代碼編寫(xiě)中verilog的設(shè)計(jì)規(guī)范

      在testbench中避免使用絕對(duì)的時(shí)間,如#20,#15或#(CYC+15)等,應(yīng)該在文件前面使用parameter定義一些常量,使得時(shí)間的定義象#(...

      2022-11-25 標(biāo)簽：Verilog代碼 1237 0

      使用開(kāi)源verilog仿真工具進(jìn)行文件的編譯和仿真

      Icarus VerilogIcarus Verilog極其小巧，支持全平臺(tái)Windows+Linux+MacOS，并且源代碼開(kāi)源。通過(guò)tb文件可以生成...

      2022-11-21 標(biāo)簽：仿真Verilog 3117 0

      Verilog常用基礎(chǔ)語(yǔ)法全梳理

      主要有三種最基本的功能定義方法，分別是always，assign，initial。一個(gè)module里面可以寫(xiě)多個(gè)always，assign，initia...

      2022-11-10 標(biāo)簽：模塊仿真Verilog 4364 0

      HLS與RTL語(yǔ)言的使用最佳實(shí)踐研究

      通過(guò)提高抽象級(jí)別，可以減少最初的設(shè)計(jì)工作量。設(shè)計(jì)人員可以集中精力描述系統(tǒng)的行為，而不必花費(fèi)時(shí)間來(lái)實(shí)現(xiàn)微體系結(jié)構(gòu)的細(xì)節(jié)。在更高的抽象級(jí)別上，也不太可能在代...

      2022-11-06 標(biāo)簽：寄存器Verilog 1318 0

      如何將算法“翻譯”成Verilog？

      然而再?gòu)?fù)雜的算法，在設(shè)計(jì)工程師的眼里，也就是一堆數(shù)學(xué)公式，算法設(shè)計(jì)者也應(yīng)該盡量做簡(jiǎn)單的算法實(shí)現(xiàn)，比如除法，求冪次方、開(kāi)平方等復(fù)雜運(yùn)算到了設(shè)計(jì)工程師這里都...

      2022-11-03 標(biāo)簽：算法Verilog 894 0

      Verilog HDL高級(jí)數(shù)字設(shè)計(jì)

      第一句話是：還沒(méi)學(xué)數(shù)電的先學(xué)數(shù)電。然后你可以選擇verilog或者VHDL，有C語(yǔ)言基礎(chǔ)的，建議選擇VHDL。因?yàn)関erilog太像C了，很容易混淆，最...

      2022-11-03 標(biāo)簽：VerilogHDL編譯器 3756 0

      同步FIFO之Verilog實(shí)現(xiàn)

      FIFO的分類根均FIFO工作的時(shí)鐘域，可以將FIFO分為同步FIFO和異步FIFO。同步FIFO是指讀時(shí)鐘和寫(xiě)時(shí)鐘為同一個(gè)時(shí)鐘。在時(shí)鐘沿來(lái)臨時(shí)同時(shí)發(fā)生...

      2022-11-01 標(biāo)簽：fifoVerilog緩存器 1974 0

      相關(guān)標(biāo)簽

      相關(guān)話題

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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        靜電防護(hù)
        +關(guān)注
        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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        Altium Designer
        +關(guān)注
      • FPGA芯片
        FPGA芯片
        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        ArduBlock
        +關(guān)注
        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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        +關(guān)注
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        +關(guān)注
      • FPGA開(kāi)發(fā)板
        FPGA開(kāi)發(fā)板
        +關(guān)注
        FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
      • PCB封裝
        PCB封裝
        +關(guān)注
        pcb封裝就是把 實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
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        +關(guān)注
        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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        +關(guān)注
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        +關(guān)注
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        +關(guān)注
        　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
      • VHDL代碼
        VHDL代碼
        +關(guān)注
      • Protel 99 se
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        +關(guān)注
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        powerlink
        +關(guān)注
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        +關(guān)注
      • 面包板
        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • AXI
        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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        驅(qū)動(dòng)電流
        +關(guān)注
      • 時(shí)鐘源
        時(shí)鐘源
        +關(guān)注
        時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英 晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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        FPGA教程
        +關(guān)注
      • Kintex-7
        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
      • 紅外觸摸屏
        紅外觸摸屏
        +關(guān)注
      • Protel DXP
        Protel DXP
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      jf_37386364 jf_03796617 jf_62405505 jf_33060107 jf_45248248 droprise jf_42740451 wowowo1 xiaonainai zhayhgaaa 476530 jf_20786649

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