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      標(biāo)簽　>　verilog

      verilog

      +關(guān)注28人關(guān)注

      Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：693個(gè) 瀏覽：110074次 帖子：927個(gè)

      verilog資訊

      uart串口代碼verilog

      uart串口代碼verilog

      　Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行...

      2017-11-09 標(biāo)簽：veriloguart代碼 7596 0

      這才是學(xué)習(xí)FPGA的正確路徑

      我把FPGA層次劃分為，雞蛋級(jí)別，菜鳥(niǎo)級(jí)別，老鳥(niǎo)級(jí)別，高手級(jí)別四類(lèi)。題主是雞蛋級(jí)別的吧！啥也不會(huì)。那些得贊高的不少都是菜鳥(niǎo)級(jí)別的選手。當(dāng)然，我現(xiàn)在告訴你...

      2016-06-07 標(biāo)簽：FPGAVerilog可編程邏輯門(mén)陣列 1.7萬(wàn) 2

      FPGA核心知識(shí)詳解（2）：FPGA入門(mén)書(shū)籍推薦篇

      電子發(fā)燒友網(wǎng)核心提示 ：對(duì)于FPGA初學(xué)者而言，正確的入門(mén)參考書(shū)籍對(duì)其至關(guān)重要。應(yīng)廣大FPGA初學(xué)者和愛(ài)好者要求，電子發(fā)燒友網(wǎng)編輯根據(jù)多名在FPGA領(lǐng)域...

      2012-11-29 標(biāo)簽：FPGASOPCVerilog 7.0萬(wàn) 13

      Altium在Altium Designer軟件內(nèi)新增Aldec FPGA仿真技術(shù)

      Altium在Altium Designer軟件內(nèi)新增Aldec FPGA仿真技術(shù)

      Altium和Aldec簽署的OEM協(xié)議中決定將Aldec的FPGA仿真功能添加到Altium Designer軟件中去。該協(xié)議的簽署使進(jìn)行FPGA（現(xiàn)...

      2012-09-20 標(biāo)簽：FPGAAltiumVerilog 2398 0

      FPGA牛人給FPGA初學(xué)者入門(mén)留下的幾點(diǎn)心得體會(huì)

      電子發(fā)燒友網(wǎng)訊： 最近有很多FPGA初學(xué)者在論壇里咨詢(xún)，F(xiàn)PGA初學(xué)者應(yīng)該從哪里開(kāi)始學(xué)起呢？為此，我找了多名做FPGA相關(guān)工作的的前輩請(qǐng)教，從而對(duì)FPG...

      2012-09-13 標(biāo)簽：FPGAverilogVHDL 4552 1

      Verilog代碼命名六大黃金規(guī)則

      電子發(fā)燒友網(wǎng)核心提示： 關(guān)于Verilog代碼中命名的六大黃金規(guī)則。 1. 系統(tǒng)級(jí)信號(hào)的命名。 系統(tǒng)級(jí)信號(hào)指復(fù)位信號(hào)，置位信號(hào)，時(shí)鐘信號(hào)等需要輸送到各個(gè)...

      2012-09-04 標(biāo)簽：Verilog代碼 6141 1

      VerilogHDL綜合性設(shè)計(jì)

      介紹利用自動(dòng)化綜合工具在編碼和綜合的階段完成用于HDTV芯片設(shè)計(jì)的優(yōu)化

      2012-06-15 標(biāo)簽：VerilogVerilogHDL 1637 0

      Verilog代碼覆蓋率檢查

      Verilog代碼覆蓋率檢查是檢查驗(yàn)證工作是否完全的重要方法，代碼覆蓋率（codecoverge）可以指示Verilog代碼描述的功能有多少在仿真過(guò)程中...

      2012-04-29 標(biāo)簽：Verilog代碼覆蓋率 8417 1

      基于Verilog實(shí)現(xiàn)電器定時(shí)開(kāi)關(guān)控制

      基于Verilog實(shí)現(xiàn)電器定時(shí)開(kāi)關(guān)控制

      隨著當(dāng)今社會(huì)工作和生活節(jié)奏的加快，人們對(duì)許多電器、儀器、設(shè)備的自動(dòng)化要求也越來(lái)越高，但現(xiàn)有的許多電器還不具備定時(shí)開(kāi)啟和關(guān)閉功能，許多需要在固定時(shí)間開(kāi)關(guān)的...

      2012-01-17 標(biāo)簽：Verilog開(kāi)關(guān)控制定時(shí)開(kāi)關(guān) 3471 0

      采用Verilog的數(shù)字跑表設(shè)計(jì)

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      本實(shí)例主要實(shí)現(xiàn)了計(jì)數(shù)及進(jìn)位的設(shè)計(jì)，通過(guò)幾個(gè)always模塊的設(shè)計(jì)實(shí)現(xiàn)一個(gè)特定用途的模塊——數(shù)字跑表。通過(guò)本實(shí)例，讀者應(yīng)達(dá)到下面的一些實(shí)例目標(biāo)

      2011-12-26 標(biāo)簽：Verilog數(shù)字跑表 4229 0

      基于Verilog簡(jiǎn)易UART的FPGA/CPLD實(shí)現(xiàn)

      在xo640上實(shí)現(xiàn)一個(gè)簡(jiǎn)單的Uart，能夠解析串口數(shù)據(jù)，并在寄存器中存儲(chǔ)，用FIFO實(shí)現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過(guò)開(kāi)發(fā)板上的串口經(jīng)CPLD訪問(wèn)各種數(shù)據(jù)...

      2011-08-05 標(biāo)簽：FPGACPLDVerilog 1933 0

      如何以10進(jìn)位顯示8位數(shù)的七段顯示器？

      七段顯示器在DE2可當(dāng)成Verilog的控制臺(tái)，做為16進(jìn)位的輸出結(jié)果。簡(jiǎn)單的使用開(kāi)關(guān)當(dāng)成2進(jìn)位輸入，并用8位數(shù)的七段顯示器顯示10進(jìn)位的結(jié)果。

      2011-05-10 標(biāo)簽：顯示器Verilog 2961 0

      博客園正式支持Verilog語(yǔ)法著色功能

      以前在貼Verilog代碼時(shí)，都只能挑C++或者C#的語(yǔ)法著色，但兩者的主題詞畢竟不太一樣，透過(guò)dudu的幫助，我將Verilog 2001年的主題詞加...

      2011-05-10 標(biāo)簽：Verilog博客園 1070 0

      verilog中阻塞賦值和非阻塞賦值

      阻塞和非阻塞語(yǔ)句作為verilog HDL語(yǔ)言的最大難點(diǎn)之一，一直困擾著FPGA設(shè)計(jì)者，即使是一個(gè)頗富經(jīng)驗(yàn)的設(shè)計(jì)工程師，也很容易在這個(gè)點(diǎn)上犯下一些不必要...

      2011-03-15 標(biāo)簽：verilog阻塞賦值非阻塞賦值 6999 1

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      在我國(guó)使用Verilog HDL的公司比使用VHDL的公司多。從EDA技術(shù)的發(fā)展上看，已出現(xiàn)用于CPLD/FPGA設(shè)計(jì)的硬件C語(yǔ)言編譯軟件，雖然還不成熟...

      2011-03-12 標(biāo)簽：FPGAverilogPLD 1785 2

      賽靈思Verilog(FPGA/CPLD)設(shè)計(jì)小技巧

      以下是一個(gè)在設(shè)計(jì)中常犯的錯(cuò)誤列表這些錯(cuò)誤常使得你的設(shè)計(jì)不可靠或速度較慢為了提高你的設(shè)計(jì)性能和提高速度的可靠性你必須確定你的設(shè)計(jì)通過(guò)所有的這些檢查。

      2011-02-23 標(biāo)簽：FPGACPLD賽靈思 1475 0

      基于Verilog硬件描述語(yǔ)言的AES密碼算法實(shí)現(xiàn)

      基于Verilog硬件描述語(yǔ)言的AES密碼算法實(shí)現(xiàn)

      　　0 引言 　　密碼模塊是安全保密系統(tǒng)的重要組成部分，其核心任務(wù)就是加/解密數(shù)據(jù)。目前，分組密碼

      2010-10-15 標(biāo)簽：Verilog 2357 0

      基于Verilog HDL設(shè)計(jì)的UART模塊

      基于Verilog HDL設(shè)計(jì)的UART模塊

      　　1 UART原理 　　串行通信是指外部設(shè)備和計(jì)算機(jī)間使用一根數(shù)據(jù)線(另外需要地線，可能還需要控制線)進(jìn)行數(shù)據(jù)傳輸?shù)姆绞?。?shù)據(jù)在一根數(shù)據(jù)線上一位一位...

      2010-08-02 標(biāo)簽：HDVerilog 2588 0

      基于FPGA和硬件描述語(yǔ)言Verilog的液晶顯示控制器的設(shè)

      基于FPGA和硬件描述語(yǔ)言Verilog的液晶顯示控制器的設(shè)

      本設(shè)計(jì)是一種基于FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)的液晶顯示控制器。與集成電路控制器相比，F(xiàn)PGA更加靈活，可以針對(duì)小同的液晶顯示模塊更改時(shí)序信號(hào)和顯示數(shù)據(jù)。...

      2010-07-02 標(biāo)簽：FPGAverilog 1319 0

      verilog PS2鍵盤(pán)解碼程序

       之前探討過(guò)PS/2鍵盤(pán)編解碼以及數(shù)據(jù)傳輸協(xié)議，這次自己動(dòng)手實(shí)現(xiàn)了利用FPGA接收鍵盤(pán)編碼，然后通過(guò)串口傳輸?shù)絇C。做的比較

      2010-06-05 標(biāo)簽：PSverilog 1989 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
      • 靜電防護(hù)
        靜電防護(hù)
        +關(guān)注
        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
      • Altium Designer
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        +關(guān)注
      • FPGA芯片
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        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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      • FPGA開(kāi)發(fā)板
        FPGA開(kāi)發(fā)板
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        FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
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        pcb封裝就是把 實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
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        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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        　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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      • 面包板
        面包板
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        面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
      • 特性阻抗
        特性阻抗
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        特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • AXI
        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
      • 驅(qū)動(dòng)電流
        驅(qū)動(dòng)電流
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        時(shí)鐘源
        +關(guān)注
        時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英 晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
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        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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        Protel DXP
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