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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于ALTERA的FPGA/CPLD下載電路設(shè)計(jì)

      基于ALTERA的FPGA/CPLD下載電路設(shè)計(jì)

      2010-04-13 | rar | 344 | 次下載 | 5積分

      資料介紹

      編程邏輯器件PLD是允許用戶編程(配置)實(shí)現(xiàn)昕需邏輯功能的器件．目前大規(guī)?？删幊踢壿嬈骷讶遮厪V泛地應(yīng)用于復(fù)雜數(shù)字系統(tǒng)的設(shè)汁中，并以其具有在系統(tǒng)重構(gòu)ISR的特點(diǎn)．給設(shè)汁的修改和系統(tǒng)升級帶來極大方便．ALTERA公司 世界最著名的可編程邏輯器件生產(chǎn)廠家之一，它的EDA開發(fā)工具M(jìn) Ax+PLuS II及其MAX7000S和FLEL10K系列器件得到了廣泛應(yīng)用，本文介紹采用JTAG接口標(biāo)準(zhǔn)模式的MAX和FLEx系列器件下載電路設(shè)計(jì)．
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