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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>從零開始學(xué)CPLD和Verilog HDL編程技術(shù)

      從零開始學(xué)CPLD和Verilog HDL編程技術(shù)

      2010-03-16 | rar | 1256 | 次下載 | 10積分

      資料介紹

      從零開始學(xué)CPLD和Verilog HDL編程技術(shù)

      CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件，是從PAL和GAL器件發(fā)展出來的器件，相對而言規(guī)模大，結(jié)構(gòu)復(fù)雜，屬于大規(guī)模集成電路范圍。是一種用戶根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。

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