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First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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fifo資訊

超全面解析FIFO的原理及應(yīng)用

First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。是一種...

2021-05-29 標(biāo)簽：單片機(jī)存儲(chǔ)器數(shù)據(jù)傳輸 3.1萬 0

MPU6050移植讀取數(shù)據(jù)時(shí)出現(xiàn)FIFO溢出問題解析

MPU-6000（6050）為全球首例整合性6軸運(yùn)動(dòng)處理組件，相較于多組件方案，免除了組合陀螺儀與加速器時(shí)間軸之差的問題，減少了大量的封裝空間。為什么F...

2017-11-29 標(biāo)簽：陀螺儀 fifo mpu6050 1.9萬 0

FullCAN和BasicCAN是什么？有何區(qū)別

診斷報(bào)文：一般選擇配置成BASIC CAN類型（結(jié)合FIFO Buffer使用），因?yàn)樵\斷報(bào)文的請(qǐng)求/響應(yīng)不能錯(cuò)序，需按照順序處理，且數(shù)據(jù)不能覆蓋；

2022-08-29 標(biāo)簽：CAN RAM fifo 1.7萬 0

FIFO具體有什么作用

First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。在計(jì)算...

2017-12-06 標(biāo)簽：fifo ad數(shù)據(jù)采集 1.4萬 0

FPGA編程時(shí)的一些實(shí)際問題闡述及解決方案詳解

問題: 隨著NI的FPGA產(chǎn)品的廣泛使用，很多同事和客戶都碰到了一些FPGA編程時(shí)遇到的問題。由于FPGA不能實(shí)時(shí)調(diào)試，每次修改一點(diǎn)代碼之后都要編譯很長...

2017-11-18 標(biāo)簽：fpga fifo 1.1萬 0

使用硬件FIFO來優(yōu)化串口的數(shù)據(jù)收發(fā)

本文在探討傳統(tǒng)數(shù)據(jù)收發(fā)不足之后，介紹如何使用帶FIFO的串口來減少接收中斷次數(shù)，通過一種自定義通訊協(xié)議格式，給出幀打包方法；之后介紹一種特殊的串口數(shù)據(jù)發(fā)...

2017-11-15 標(biāo)簽：fifo 串口 1.1萬 0

異步FIFO的設(shè)計(jì)分析及詳細(xì)代碼

本文首先對(duì)異步 FIFO 設(shè)計(jì)的重點(diǎn)難點(diǎn)進(jìn)行分析，最后給出詳細(xì)代碼。一、FIFO簡(jiǎn)單講解 FIFO的本質(zhì)是RAM，先進(jìn)先出重要參數(shù)：fifo深度（...

2017-11-15 標(biāo)簽：fifo 8620 0

LabVIEW FPGA模塊實(shí)現(xiàn)FIFO深度設(shè)定

為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理...

2011-09-26 標(biāo)簽：FPGA LabVIEW FIFO 7363 0

在FPGA設(shè)計(jì)中FIFO的使用技巧

FIFO是在FPGA設(shè)計(jì)中使用的非常頻繁，也是影響FPGA設(shè)計(jì)代碼穩(wěn)定性以及效率等得關(guān)鍵因素。在數(shù)據(jù)連續(xù)讀取時(shí)，為了能不間斷的讀出數(shù)據(jù)而又不導(dǎo)致FIFO...

2021-09-09 標(biāo)簽：fpga Xilinx fifo 6943 0

關(guān)于Video out IP和Video Timing Controller IP的介紹

本文對(duì)Video out IP和Video Timing Controller IP進(jìn)行簡(jiǎn)要介紹，為后文完成使用帶有HDMI接口的顯示器構(gòu)建圖像視頻顯示...

2021-05-08 標(biāo)簽：顯示器發(fā)生器 fifo 6602 0

全面介紹ZYNQ-AXI互聯(lián)IP

學(xué)習(xí)內(nèi)容近期設(shè)計(jì)需要用到AXI總線的IP，所以就對(duì)應(yīng)常用的IP進(jìn)行簡(jiǎn)要的說明，本文主要對(duì)AXI互聯(lián)IP進(jìn)行介紹。基礎(chǔ)架構(gòu)IP 基礎(chǔ)的IP是用于幫助組...

2021-05-11 標(biāo)簽：控制器數(shù)據(jù)IP 6456 0

XILINX FIFO寫不進(jìn)去的問題分析及解決方法

明德?lián)P(MDY)在某個(gè)XILINX項(xiàng)目中，偶然性出現(xiàn)開機(jī)后通信出錯(cuò)的情形，具體表現(xiàn)為反復(fù)開機(jī)測(cè)試400次后，約有1~2次通信異常，數(shù)據(jù)發(fā)不出去。經(jīng)過定位...

2022-03-01 標(biāo)簽：芯片測(cè)試 fifo 5937 0

詳解同步FIFO和異步FIFO?

1.定義 FIFO是英文First In First Out 的縮寫，是一種先進(jìn)先出的數(shù)據(jù)緩存器，他與普通存儲(chǔ)器的區(qū)別是沒有外部讀寫地址線，這樣使用起來...

2021-04-09 標(biāo)簽：fifo 異步FIFO 同步FIFO 5477 0

基于VHDL的異步FIFO設(shè)計(jì)

該設(shè)計(jì)采用VHDL語言進(jìn)行設(shè)計(jì)，利用ALTERA公司的FPGA得以實(shí)現(xiàn)。經(jīng)驗(yàn)證進(jìn)一步表明，模塊化的設(shè)計(jì)不僅避免了亞穩(wěn)態(tài)的產(chǎn)生，增大平均無故障工作時(shí)間(M...

2011-08-18 標(biāo)簽：FIFO VHDL 異步FIFO 5472 0

A7139 無線模塊驅(qū)動(dòng)（STM32）增加FIFO擴(kuò)展模式的底層代碼

A7139 擁有電磁波喚醒以及10mW的發(fā)射功率，非常容易實(shí)現(xiàn)長距離通信，目前測(cè)試有障礙物可以輕松達(dá)到300m以上。通過幾天的調(diào)試，目前可以發(fā)送任意大小...

2017-10-27 標(biāo)簽：fifo 無線模塊 a7139 5042 0

一文詳解XILINX的可參數(shù)化FIFO

FIFO是FPGA項(xiàng)目中使用最多的IP核，一個(gè)項(xiàng)目使用幾個(gè)，甚至是幾十個(gè)FIFO都是很正常的。通常情況下，每個(gè)FIFO的參數(shù)，特別是位寬和深度，是不同的。

2022-03-08 標(biāo)簽：fpga Xilinx fifo 5030 0

探究華芯微特MCU引領(lǐng)低成本屏驅(qū)解決方案

隨著工業(yè)產(chǎn)品越來越注重用戶體驗(yàn)，通過TFT LCD屏實(shí)現(xiàn)人機(jī)交互的應(yīng)用也越來越多。 SWM32SRE超高的性價(jià)比，在中小尺寸TFT LCD屏驅(qū)應(yīng)用中，是...

2021-06-04 標(biāo)簽：寄存器 PWM 晶振 4842 0

FIFO隊(duì)列的串口數(shù)據(jù)收發(fā)方法

在嵌入式軟件的開發(fā)中，串口是十分常用且基礎(chǔ)的功能。在需要批量發(fā)送數(shù)據(jù)的場(chǎng)合，可以使用while循環(huán)等待發(fā)送完成標(biāo)志位的方式，但是這種方式會(huì)占據(jù)主循環(huán)，影響效率。

2022-07-12 標(biāo)簽：操作系統(tǒng)fifo 串口數(shù)據(jù) 4272 0

異步fifo詳解

異步fifo詳解一. 什么是異步FIFO FIFO即First in First out的英文簡(jiǎn)稱，是一種先進(jìn)先出的數(shù)據(jù)緩存器，與普通存儲(chǔ)器的區(qū)別在于...

2022-12-12 標(biāo)簽：fifo 4157 0

高速多通道數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

電子發(fā)燒友網(wǎng)核心提示：本設(shè)計(jì)采用DE2、THDB-ADA平臺(tái)進(jìn)行開發(fā)。DE2平臺(tái)選用FPGA EP2C35F672。THDB-ADA是針對(duì)DE2開發(fā)板設(shè)...

2012-11-27 標(biāo)簽：DSP FPGA FIFO 4116 0

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

+關(guān)注

為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識(shí)別

識(shí)別

+關(guān)注
FPGA開發(fā)板

FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

+關(guān)注

pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

+關(guān)注

Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
PCB封裝庫

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語音交互

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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