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vcs技術(shù)

芯片后仿之SDF 3.0解析(三)

本文接著解析SDF3.0的Timing Checks Entries、Timing Environment Entries兩個(gè)部分。

2024-04-16 標(biāo)簽：仿真 VCS 時(shí)序分析 1664 0

淺析SpinalHDL中Pipeline中的復(fù)位定制

之前有系列文章介紹了SpinalHDL中Pipeline的使用，最近在一個(gè)功能模塊中真實(shí)的使用了這個(gè)lib。

2024-03-17 標(biāo)簽：FPGA 寄存器仿真器 1036 0

優(yōu)化編譯和仿真的VCS使用技巧

任何事情的選擇很難是各個(gè)方面都會(huì)帶來(lái)優(yōu)勢(shì)，所以需要結(jié)合自己的項(xiàng)目去權(quán)衡應(yīng)該優(yōu)化那些方面，哪里是關(guān)鍵的設(shè)計(jì)，那么選擇優(yōu)化該方向。相關(guān)建議可以在文件dpo_...

2024-03-08 標(biāo)簽：內(nèi)存 VCS 1253 0

AI（VSO）賦能的VCS驗(yàn)證流程

本質(zhì)是讓設(shè)計(jì)人員聚焦于修復(fù)BUG，而不是花時(shí)間發(fā)現(xiàn)BUG。將需要大量人力的工作交給AI，極大的推動(dòng)了覆蓋率收斂的速度。

2024-03-01 標(biāo)簽：AI VCS 1198 0

網(wǎng)表時(shí)序仿真案例：淺說(shuō)$width語(yǔ)法

在verilog中，$width是時(shí)序檢查函數(shù)，用于檢查脈沖的位寬是否符合要求。

2024-03-01 標(biāo)簽：Verilog VCS CLK 2847 0

如何對(duì)Verilog/SystemVerilog代碼加密

os模塊中的system()函數(shù)接受一個(gè)字符串參數(shù)，其中包含要執(zhí)行的命令。在21-22行中，line為字符串變量，和前面雙引號(hào)中的linux命令拼接在一...

2024-01-15 標(biāo)簽：Verilog 字符串 VCS 3000 0

VCS 仿真option 解析

VCS的仿真選項(xiàng)分編譯（compile-time）選項(xiàng)和運(yùn)行（run-time）選項(xiàng)。編譯選項(xiàng)用于RTL/TB的編譯，一遍是編譯了就定了，不能在仿真中更...

2024-01-06 標(biāo)簽：RTL VCS 2798 0

NCSIM、VCS和QuestaSim后仿真如何屏蔽冗余的違例信息呢？

在進(jìn)行數(shù)字電路后仿真時(shí)，經(jīng)常會(huì)遇到很多時(shí)序?yàn)槔ǔ＿@些違例都是由網(wǎng)表中大量的時(shí)序檢查報(bào)出的。

2024-01-03 標(biāo)簽：EDA工具 soc 數(shù)字電路 2571 0

RTL仿真中X態(tài)行為的傳播—從xprop說(shuō)起

在使用VCS進(jìn)行仿真時(shí)，工程師們常常會(huì)面對(duì)一個(gè)極為重要且充滿(mǎn)挑戰(zhàn)的問(wèn)題——X態(tài)傳播行為。

2023-12-04 標(biāo)簽：仿真器 VHDL語(yǔ)言 RTL 2695 0

verilog中有符號(hào)數(shù)和無(wú)符號(hào)數(shù)的本質(zhì)探究

不知道有沒(méi)有人像我一樣，長(zhǎng)久以來(lái)將verilog中的有符號(hào)數(shù)視為不敢觸碰的禁區(qū)。

2023-12-04 標(biāo)簽：仿真器 Verilog VCS 1182 0

以xa-vcs為例如何進(jìn)行cosim仿真驗(yàn)證？

**1 ** 層級(jí)關(guān)系曾經(jīng)我一直認(rèn)為cosim最頂層必須是一個(gè)數(shù)字頂層，其實(shí)不然。具體使用哪個(gè)做頂層要看項(xiàng)目，以數(shù)字為頂層的好處是，模擬仿真的結(jié)果都轉(zhuǎn)...

2023-10-31 標(biāo)簽：EDA工具加法器電平轉(zhuǎn)換 4080 0

std::randomize隨機(jī)結(jié)果不符合預(yù)期？

在近期的一個(gè)testcase調(diào)試中，遇到一個(gè)std::randomize隨機(jī)結(jié)果不符合預(yù)期的現(xiàn)象。

2023-10-29 標(biāo)簽：EDA工具仿真器 STD 2006 0

vcs和xrun搭配uvm1.1/uvm1.2版本庫(kù)的使用情況

我們?cè)陧?xiàng)目中有時(shí)候需要使用不同的UVM版本庫(kù)進(jìn)行仿真，有時(shí)候還會(huì)在不同的仿真器之間進(jìn)行切換，本文簡(jiǎn)單總結(jié)了一下vcs和xrun搭配uvm1.1/uvm1...

2023-10-27 標(biāo)簽：仿真器 UVM VCS 4050 0

systemverilog：logic比reg更有優(yōu)勢(shì)

在systemverilog協(xié)議中，logic定義四態(tài)值，即向量（vector）的每個(gè)位（bit）可以是邏輯0, 1, Z或X，與verilog協(xié)議中的...

2023-10-26 標(biāo)簽：芯片設(shè)計(jì)Verilog System 1128 0

vcs實(shí)用技巧

VCS是編譯型verilog仿真器，VCS先將verilog/systemverilog文件轉(zhuǎn)化為C文件，在linux下編譯生成的可執(zhí)行文./simv即...

2023-10-25 標(biāo)簽：Linux 仿真器 Verilog 1069 0

systemverilog：logic比reg更有優(yōu)勢(shì)？

在systemverilog協(xié)議中，logic定義四態(tài)值，即向量（vector）的每個(gè)位（bit）可以是邏輯0, 1, Z或X，與verilog協(xié)議中的...

2023-09-28 標(biāo)簽：驅(qū)動(dòng)器仿真器 RTL 2516 0

VCS ICO的主要功能有哪些呢？

ico是vcs提供的用于優(yōu)化覆蓋率的feature；一般用戶(hù)通過(guò)dist solver bofore等約束了變量的隨機(jī)概率，而ico會(huì)在用戶(hù)約束的基礎(chǔ)上...

2023-09-19 標(biāo)簽：VCS RCA 機(jī)器學(xué)習(xí) 1458 0

Verilog編碼中位寬不匹配的危害是什么？

位寬不匹配會(huì)導(dǎo)致綜合產(chǎn)生的網(wǎng)表與個(gè)人預(yù)期差異較大，導(dǎo)致功能不正確。VCS仿真能及時(shí)發(fā)現(xiàn)問(wèn)題，但VCS仿真存在部分場(chǎng)景沒(méi)有覆蓋的問(wèn)題，因此僅僅通過(guò)VCS仿...

2023-09-19 標(biāo)簽：Verilog VCS 1716 0

如何在EDA工具中屏蔽冗余的違例信息

在進(jìn)行數(shù)字電路后仿真時(shí)，經(jīng)常會(huì)遇到很多時(shí)序?yàn)槔?，通常這些違例都是由網(wǎng)表中大量的時(shí)序檢查報(bào)出的。這些常見(jiàn)的時(shí)序檢查系統(tǒng)任務(wù)如下表所示：

2023-08-19 標(biāo)簽：仿真 eda 數(shù)字電路 1156 0

寫(xiě)assertion很痛苦？了解一下SVA Checker Library

請(qǐng)根據(jù)這段代碼寫(xiě)一個(gè)assertion檢查 count 每次加5。

2023-08-12 標(biāo)簽：VCS SVA FIFO存儲(chǔ) 1184 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
PCB封裝庫(kù)

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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candence

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
驅(qū)動(dòng)電流

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時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
紅外觸摸屏

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